400-885-9898
职位描述
DFTVerilog電子/半導體/集成電路
招23/24屆/25屆 本科/碩士畢業的同學，熟悉verilog，Python，perl
主要職責:
1與芯片設計團隊合作，提供DFT(Design For Test/可測性設計)實施的方法學支持
任職要求：
1.理解數字邏輯設計和微電子學的基本概念。
2.熟悉Verilog語言。了解ASIC設計流程和方法。
3.具有一定的英文讀寫能力, 能夠使用英文進行工作溝通，過四六級。
4.良好的分析和解決問題的能力。
5.良好的團隊合作精神和溝通技巧。
加分項：
具備腳本編程經驗，如Tcl/Python/Perl。
了解SDC, 靜態時序約束。
具有使用EDA工具的基本經驗。
具備基本的DFT知識原理，了解DFTCompiler/Tessent工具。
主要職責:
1與芯片設計團隊合作，提供DFT(Design For Test/可測性設計)實施的方法學支持
任職要求：
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2.熟悉Verilog語言。了解ASIC設計流程和方法。
3.具有一定的英文讀寫能力, 能夠使用英文進行工作溝通，過四六級。
4.良好的分析和解決問題的能力。
5.良好的團隊合作精神和溝通技巧。
加分項：
具備腳本編程經驗，如Tcl/Python/Perl。
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具有使用EDA工具的基本經驗。
具備基本的DFT知識原理，了解DFTCompiler/Tessent工具。
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工作地点
北京朝陽區酒仙橋
以担保或任何理由索要财物，扣押证照，均涉嫌违法。一经发现，
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山東芯慧微電子科技有限公司
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职位发布者
楊林利/人事經理
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