職位描述
FPGA設(shè)計VHDLVerilog
崗位職責(zé)
1、負(fù)責(zé)FPGA的詳細(xì)設(shè)計、驗證、實現(xiàn)和維護(hù)。
2、與硬件、驅(qū)動軟件協(xié)作，負(fù)責(zé)設(shè)備開發(fā)、生產(chǎn)、使用過程中的問題定位和解決。
任職要求：
1、微電子、計算機(jī)、電子、通信、自動化等相關(guān)專業(yè);
2、熟悉VHDL/Verilog等數(shù)字芯片設(shè)計語言，有FPGA設(shè)計經(jīng)驗;
3、熟悉驗證工具，了解一種或多種驗證方法，并根據(jù)項目的特點(diǎn)制定不同的驗證策略、方案，搭建驗 證環(huán)境，完成驗證執(zhí)行和 Debug
工作地點(diǎn)
武侯區(qū)綠地之窗四川省成都市高新區(qū)天府二街綠地之窗2號樓616
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職位發(fā)布者
王玉霞/HRM
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